Profibus DP Master for Altera FPGA
使用英特尔（Altera）FPGA将PROFIBUS DP集成到工业控制器中
PROFIBUS DP主IP核心集成了基于FPGA技术实现完整的PROFIBUS DP Class1和Class2主站所需的组件。因此，另外，没有特定的现场总线控制器ASIC。
最低发展努力
- 实现PROFIBUS DP Class 1或Class 2主控到现场可编程门阵列(FPGA)所需的所有组件的组合
- PROFIBUS DP总线控制逻辑可作为可加载的IP核心提供
- PROFIBUS DP协议栈准备好在FPGA中用于软核处理器
- 控制应用程序运行在FPGA内部的第二个处理器或单独的外部主机处理器上
- 包括PROFIBUS DP版本DP（循环数据和诊断与从设备的诊断），DP-V1（无循环数据交换和报警处理）以及DP-V2（时钟同步和时间戳）
通过集成现场总线控制器的灵活性
- 提供完整的总线控制逻辑访问PROFIBUS DP网络
- PROFIBUS DP数据链路层所有时间关键部分的处理，令牌处理和循环数据交换
- 没有依赖现场总线控制器ASIC及其供应商
改善植物可用性
- 支持主冗余，从主备用Profibus DP Master提供无缝切换
- 可选线路冗余功能，通过冗余现场总线电缆访问现场设备
- 支持重新配置单个PROFIBUS从站而不进行关闭计划
| 支持奴隶设备 | ≤125 | ||
| 总循环输入/输出 数据 |
≤30,500bytes/≤30,500bytes. |
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| 每个从站的输入/输出数据 | ≤244字节/≤244字节 |
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| 配置/参数/ 每个从站的诊断数据 |
≤244bytes/≤244bytes/≤244bytes |
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| 协议 | PROFIBUS DP-V0，PROFIBUS DP-V1，PROFIBUS DP-V2，PROFIBUS FDL | ||
| 现场总线DP-V1特性 |
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| 附加功能 |
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| 可选功能（版本的一部分） |
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| 可选功能（单独的项目） | 线路冗余（操作两个独立的物理连接） | ||
| 系统要求 |
记忆 | 代码:512KB，内存:512KB |
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| FPGA. | Altera Cyclone III, IV或V, Arria II | ||
| FPGA资源 | 纯IP核心 | 典型的IP核设计，Nios II，内存控制器 | |
| 逻辑元素 | 6K. | 16K. | |
| 内存块（M10K） | 13. | 16K. | |
| 许可 | 每单位基础或年底 | ||
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| PROFIBUS DP Master, IP Core and Protocol Stack (DP- v0, DP- v1，无主冗余) | |
| KXL-NN-016412 | 开发包（包括许可证模型所需的软件和文档） |
| isl - yy - 015310 | 每个主设备的单位许可证（安全EEPROM，包装单位：250件） |
| LAA-NN-019310 | 年度产品许可费(一个客户产品一年不限数量销售的权利) |
| lfa - nn - 019340 | 选项PROFIBUS DP线路冗余PROFIBUS DP Master IP核心（一名客户产品的一次性费用） |
| PROFIBUS DP Master Pro，IP核心和协议栈（DP-V0，DP-V1，DP-V2和主冗余） | |
| KXL-NN-016412 | 开发包（包括许可证模型所需的软件和文档） |
| isl - yy - 015311 | 每个主设备的单位许可证（安全EEPROM，包装单位：250件） |
| LAA-NN-019311 | 年度产品许可费(一个客户产品一年不限数量销售的权利) |
| lfa - nn - 019340 | 选项PROFIBUS DP线路冗余PROFIBUS DP Master IP核心（一名客户产品的一次性费用） |
供货范围
| IP核心 | Altera CVE开发套件(利用Cyclone VE FPGA - 5CEFA7F31I7N) |
| 软件 |
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| 文件 | PROFIBUS DP堆栈手册和PROFIBUS MASTER评估指南，电子格式 |
其他产品和服务
| KEL-NN-016310 | 基于Altera Cyclone III FPGA的PROFIBUS DP主控IP核及协议软件评估包 |
| 新航- nn - 018101 | PROFIBUS DP Integration Workshop |
| DDA-NN-006014 | PROFIBUS测试仪5 BC-700-PB |
| TRA-PB-TECH | 现场总线技术培训 |
培训
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